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開(kāi)源 VHDL 驗(yàn)證方法 (OSVVM) 是一種智能測(cè)試平臺(tái)方法，允許將“智能覆蓋”與定向、算法、基于文件和約束隨機(jī)方法混合。 OSVVM是專(zhuān)門(mén)用于VHDL驗(yàn)證的集成環(huán)境。 OSVVM 是一組 VHDL 軟件包，最初由 Aldec 和 Synthworks 開(kāi)發(fā)。 OSVVM 可幫助您采用使用 VHDL 的現(xiàn)代約束隨機(jī)驗(yàn)證技術(shù)。借助 OSVVM，人們可以將高級(jí)驗(yàn)證方法添加到當(dāng)前的測(cè)試平臺(tái)中，而無(wú)需學(xué)習(xí)新語(yǔ)言或拋棄現(xiàn)有的測(cè)試平臺(tái)模型。 OSVVM 支持與基于其他驗(yàn)證方法的功能相同的功能。其中包括事務(wù)級(jí)建模、約束隨機(jī)測(cè)試生成、功能覆蓋、消息過(guò)濾、記分板和 FIFO、錯(cuò)誤報(bào)告等。
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