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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>網(wǎng)絡(luò)協(xié)議論文>基于FPGA的Kohonen競(jìng)爭(zhēng)網(wǎng)絡(luò)硬件實(shí)現(xiàn)

      基于FPGA的Kohonen競(jìng)爭(zhēng)網(wǎng)絡(luò)硬件實(shí)現(xiàn)

      2009-06-18 | rar | 151 | 次下載 | 3積分

      資料介紹

      本文介紹了神經(jīng)網(wǎng)絡(luò)VLSI硬件實(shí)現(xiàn)的基本情況和VerilgHDL硬件設(shè)計(jì)方法的概念，在此基礎(chǔ)上利用FPGA設(shè)計(jì)出了Kohonen競(jìng)爭(zhēng)網(wǎng)絡(luò)硬件電路，其工作頻率為33Mhz，并對(duì)其工作過(guò)程進(jìn)行了較詳細(xì)的分析，給出了綜合仿真的測(cè)試結(jié)果。
      關(guān)鍵詞：神經(jīng)網(wǎng)絡(luò)硬件實(shí)現(xiàn) Kohonen競(jìng)爭(zhēng)網(wǎng)絡(luò)算法 VerilgHDL FPGA
      Abstract: This paper introduces the basic complexion of neural network VLSI hardware realization and the concept of VerilgHDL hardware’s design. Based on that, it designs Kohonen competitive network hardware circuit by utilizing FPGA, which working frequency is 33Mhz. Then in this paper detailedly analyses its working process, and provides the testing result of integrated simulation.
      Keywords: neural network hardware realization; Kohonen competitive network arithmetic; VerilgHDL; FPGA
      網(wǎng)絡(luò)硬件
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