fifo

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First Input First Output的縮寫，先入先出隊(duì)列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進(jìn)入的指令先完成并引退，跟著才執(zhí)行第二條指令。

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fifo資訊

大規(guī)模ASIC或FPGA設(shè)計(jì)中異步FIFO設(shè)計(jì)闡述

一、概述在大規(guī)模ASIC或FPGA設(shè)計(jì)中，多時(shí)鐘系統(tǒng)往往是不可避免的，這樣就產(chǎn)生了不同時(shí)鐘域數(shù)據(jù)傳輸?shù)膯?wèn)題，其中一個(gè)比較好的解決方案就是使用異步FIF...

2021-09-30 標(biāo)簽：fpga asic fifo 2.5k 0

采用FPGA協(xié)處理器實(shí)現(xiàn)算法加速教程

當(dāng)今的設(shè)計(jì)工程師受到面積、功率和成本的約束，不能采用GHz級(jí)的計(jì)算機(jī)實(shí)現(xiàn)嵌入式設(shè)計(jì)。在嵌入式系統(tǒng)中，通常是由相對(duì)數(shù)量較少的算法決定最大的運(yùn)算需求。使用設(shè)...

2021-09-28 標(biāo)簽：fpga cpu 數(shù)據(jù) 4.9k 0

Verilog HDL-同步技術(shù)你了解多少

同步技術(shù) 在芯片設(shè)計(jì)中，數(shù)據(jù)同步和在不同時(shí)鐘域之間進(jìn)行數(shù)據(jù)傳輸會(huì)經(jīng)常出現(xiàn)。為避免任何差錯(cuò)、系統(tǒng)故障和數(shù)據(jù)破壞，正確的同步和數(shù)據(jù)傳輸就顯得格外重要。這些問(wèn)...

2021-09-18 標(biāo)簽：usb fifo Verilog 3.1k 0

你們知道FIFO最小深度計(jì)算嗎

FIFO 最小深度計(jì)算例子 - 1：f_wr 》 f_rd，連續(xù)讀寫寫時(shí)鐘80MHz。讀時(shí)鐘50MHz。 Burst_Len = 120，也就是要...

2021-09-10 標(biāo)簽：數(shù)據(jù)fifo 計(jì)算 2.7k 0

在FPGA設(shè)計(jì)中FIFO的使用技巧

FIFO是在FPGA設(shè)計(jì)中使用的非常頻繁，也是影響FPGA設(shè)計(jì)代碼穩(wěn)定性以及效率等得關(guān)鍵因素。在數(shù)據(jù)連續(xù)讀取時(shí)，為了能不間斷的讀出數(shù)據(jù)而又不導(dǎo)致FIFO...

2021-09-09 標(biāo)簽：fpga Xilinx fifo 7.9k 0

FPGA中的FWFT神秘操作你知道嗎？

QAFirst-Word Fall-Through（FWFT）讀取操作在查看Xilinx KINTEX-7 FPGA存儲(chǔ)器資源時(shí)，你會(huì)發(fā)現(xiàn)它的FIFO...

2021-06-25 標(biāo)簽：fpga 存儲(chǔ)器 fifo 4.7k 0

探究華芯微特MCU引領(lǐng)低成本屏驅(qū)解決方案

隨著工業(yè)產(chǎn)品越來(lái)越注重用戶體驗(yàn)，通過(guò)TFT LCD屏實(shí)現(xiàn)人機(jī)交互的應(yīng)用也越來(lái)越多。 SWM32SRE超高的性價(jià)比，在中小尺寸TFT LCD屏驅(qū)應(yīng)用中，是...

2021-06-04 標(biāo)簽：寄存器 PWM 晶振 6k 0

超全面解析FIFO的原理及應(yīng)用

First Input First Output的縮寫，先入先出隊(duì)列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進(jìn)入的指令先完成并引退，跟著才執(zhí)行第二條指令。是一種...

2021-05-29 標(biāo)簽：單片機(jī)存儲(chǔ)器數(shù)據(jù)傳輸 3.3萬(wàn) 0

全面介紹ZYNQ-AXI互聯(lián)IP

學(xué)習(xí)內(nèi)容近期設(shè)計(jì)需要用到AXI總線的IP，所以就對(duì)應(yīng)常用的IP進(jìn)行簡(jiǎn)要的說(shuō)明，本文主要對(duì)AXI互聯(lián)IP進(jìn)行介紹。基礎(chǔ)架構(gòu)IP 基礎(chǔ)的IP是用于幫助組...

2021-05-11 標(biāo)簽：控制器數(shù)據(jù)IP 8k 0

FIFO最小深度計(jì)算所有情況

由于平時(shí)我們工作中，F(xiàn)IFO都是直接調(diào)用IP核，對(duì)于FIFO深度選擇并沒(méi)有很在意，而在筆試面試過(guò)程中，經(jīng)常被問(wèn)及的問(wèn)題之一就是如何計(jì)算FIFO深度。當(dāng)...

2021-05-11 標(biāo)簽：fifo 2.8k 0

關(guān)于Video out IP和Video Timing Controller IP的介紹

本文對(duì)Video out IP和Video Timing Controller IP進(jìn)行簡(jiǎn)要介紹，為后文完成使用帶有HDMI接口的顯示器構(gòu)建圖像視頻顯示...

2021-05-08 標(biāo)簽：顯示器發(fā)生器 fifo 8.5k 0

為什么有時(shí)候FIF不能正常工作？

同步控制信號(hào) 對(duì)于讀/寫時(shí)鐘相互獨(dú)立的FIFO（讀/寫時(shí)鐘獨(dú)立意味著這兩個(gè)時(shí)鐘是異步的，例如來(lái)自于不同的MMCM），要確保相應(yīng)的控制信號(hào)只在與之對(duì)應(yīng)的時(shí)...

2021-04-26 標(biāo)簽：fifo 同步控制 3.2k 0

探究FPGA與ARM的無(wú)人機(jī)陀螺儀數(shù)據(jù)接口設(shè)計(jì)

在無(wú)人機(jī)系統(tǒng)與地面站通信過(guò)程中，機(jī)載陀螺儀姿態(tài)數(shù)據(jù)的高速產(chǎn)生與外部相對(duì)低速的無(wú)線數(shù)據(jù)模塊傳輸?shù)拿苋找?/p>

2021-05-05 標(biāo)簽：fpga arm fifo 3.6k 0

關(guān)于RTOS任務(wù)間通信和全局變量之間的區(qū)別解析

隊(duì)列（queue）是一種只能在一端插入元素、在另一端刪除元素的數(shù)據(jù)結(jié)構(gòu)，遵循先入先出（FIFO）的規(guī)則。

2021-04-19 標(biāo)簽：fifo RTOS 消息隊(duì)列 3.9k 0

淺談一種用于MEMS姿態(tài)檢測(cè)的FIFO設(shè)計(jì)

通過(guò)在MEMS信號(hào)處理電路中設(shè)計(jì)一個(gè)異步結(jié)構(gòu)的FIFO，可以有效地降低系統(tǒng)對(duì)MEMS的頻繁訪問(wèn)。設(shè)計(jì)一個(gè)具有多種工作模

2021-04-15 標(biāo)簽：mems RAM fifo 2.5k 0

FPGA驗(yàn)證簡(jiǎn)介之FPGA開(kāi)發(fā)分析一個(gè)testbench

很多FPGA/IC開(kāi)發(fā)工具都提供設(shè)計(jì)例子，方便使用者學(xué)習(xí)和練習(xí)，例如，Xilinx ISE提供了很多設(shè)計(jì)實(shí)例，放在ISE5.X的安裝目錄下的ISEexa...

2021-04-11 標(biāo)簽：IC fifo CLK 4k 0

詳解同步FIFO和異步FIFO?

1.定義 FIFO是英文First In First Out 的縮寫，是一種先進(jìn)先出的數(shù)據(jù)緩存器，他與普通存儲(chǔ)器的區(qū)別是沒(méi)有外部讀寫地址線，這樣使用起來(lái)...

2021-04-09 標(biāo)簽：fifo 異步FIFO 同步FIFO 6.4k 0

探究USB接口的VSAT基帶數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

針對(duì)衛(wèi)星接收設(shè)備數(shù)據(jù)采集的實(shí)際需要，提出一種基于USB接口的VSAT（甚小口徑衛(wèi)星終端）基帶數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)方

2021-04-08 標(biāo)簽：芯片 cpld USB接口 3.1k 0

解析MIPS內(nèi)核的HDTV-SoC平臺(tái)總線接口模塊

介紹了使用MIPS32TM4KcTM處理器作為CPU內(nèi)核的高清晰度電視（HDTV）SoC平臺(tái)，著重提出了該平臺(tái)上系統(tǒng)總線接口（HIF）模塊

2021-04-07 標(biāo)簽：處理器 RAM fifo 3.6k 0

如何在Altera FPGA中使用FIFO實(shí)現(xiàn)功能設(shè)計(jì)？

一：fifo是什么 FIFO的完整英文拼寫為FirstIn First Out，即先進(jìn)先出。FPGA或者ASIC中使用到的FIFO一般指的是對(duì)數(shù)據(jù)的存儲(chǔ)...

2021-03-12 標(biāo)簽：fpga fifo 4.2k 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

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PDN

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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powerlink

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Protel 99 se

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面包板

面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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