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標(biāo)簽 > pll
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鎖相環(huán)(PLL)是現(xiàn)代通信系統(tǒng)的基本構(gòu)建模塊PLLs通常用在無線電接收機(jī)或發(fā)射機(jī)中,主要提供"本振"(LO)功能;也可用于時鐘信號分配和降噪,而且越來越...
基于DDS+PLL在電臺設(shè)計(jì)中的應(yīng)用
本文將介紹DDS和PLL的工作原理,并結(jié)合一電臺(工作頻率2 MHz~500 MHz)的設(shè)計(jì),給出DDS做參考的PLL頻率合成器的設(shè)計(jì)方案。
高性能鎖相回路(PLL)的單芯片時鐘IC Si5374和Si5375
Si5374和Si5375是業(yè)界第一款集成了四個獨(dú)立高性能鎖相回路(PLL)的單芯片時鐘IC,它所提供的PLL集成是其它競爭解決方案的兩倍,抖動則低了40%。
頻率合成是指將高精度和高穩(wěn)定度的標(biāo)準(zhǔn)信號頻率通過一系列的算術(shù)運(yùn)算,產(chǎn)生具有相同穩(wěn)定度和精確度的大量離散頻率的技術(shù)。鎖相式頻率源具有頻率穩(wěn)定度高、頻譜純、...
可以通過不同架構(gòu)實(shí)現(xiàn)時鐘恢復(fù),測量設(shè)備中最常用的是基于鎖相環(huán)(PLL)的方法。根據(jù)在數(shù)據(jù)中看到的跳變,使用恢復(fù)電路導(dǎo)出與輸入數(shù)據(jù)同步的時鐘,這取決于看到...
基于DDS+PLL實(shí)現(xiàn)跳頻信號源的設(shè)計(jì)方法
航空通信設(shè)備包括短波通信、超短波通信設(shè)備,短波、超短波通信設(shè)備又分為常規(guī)通信方式和跳頻通信方式,跳頻通信因具有抗干擾性強(qiáng)、抗偵測能力好、頻譜利用率高和易
隨著數(shù)字技術(shù)的飛速發(fā)展,使頻率合成技術(shù)也躍上了一個新的臺階。傳統(tǒng)的頻率合成器,通常從一排晶體振蕩器產(chǎn)生的各種頻率通過開關(guān)進(jìn)行頻率混合,或者采用鎖相(PL...
PLL-VCO設(shè)計(jì)及制作第二部分?VCO電路的設(shè)計(jì)VCO電路為使用上章的備注欄所介紹的庫拉普振蕩電路。將線圈與電容組合,使達(dá)到設(shè)計(jì)規(guī)格的40M~60MH...
PLL電路設(shè)計(jì)原理及制作 在通信機(jī)等所使用的振蕩電路,其所要求的頻率范圍要廣,且頻率的穩(wěn)定度要高。無論多好的LC振蕩電路,其頻率的穩(wěn)定度,都無法
2010-05-15 標(biāo)簽:PLL 3.2k 0
DDS+PLL高性能頻率合成器的設(shè)計(jì)方案 頻率合成理論自20世紀(jì)30年代提出以來,已取得了迅速的發(fā)展,逐漸形成了直接頻率合成技術(shù)、鎖相頻率合成技術(shù)、直...
PLL和TDA7010T的無線收發(fā)系統(tǒng)設(shè)計(jì)
PLL和TDA7010T的無線收發(fā)系統(tǒng)設(shè)計(jì) 摘要:設(shè)計(jì)一種基于PLL和TDA7010T的無線收發(fā)系統(tǒng)。該系統(tǒng)由發(fā)射電路、接收電路和控制電路3部分
DSP內(nèi)嵌PLL中的CMOS壓控環(huán)形振蕩器設(shè)計(jì)
DSP內(nèi)嵌PLL中的CMOS壓控環(huán)形振蕩器設(shè)計(jì) 1 引言 在現(xiàn)代高性能DSP芯片設(shè)計(jì)中,鎖相環(huán)(PLL)被廣泛用作片內(nèi)時鐘發(fā)生器
模擬PLL,模擬PLL是什么意思 所謂模擬PLL,就是說數(shù)字PLL中的各個模塊的實(shí)現(xiàn)都是以模擬器件來實(shí)現(xiàn)的,是一個模擬
數(shù)字PLL,什么是數(shù)字PLL 數(shù)字PLL PLL的概念 我們所說的PLL,其實(shí)就是鎖相環(huán)路,簡稱為鎖相環(huán)。許多電子設(shè)備要正常工作,通常
異步FIFO和PLL在高速雷達(dá)數(shù)據(jù)采集系統(tǒng)中的應(yīng)用
異步FIFO和PLL在高速雷達(dá)數(shù)據(jù)采集系統(tǒng)中的應(yīng)用 1 引言 隨著雷達(dá)系統(tǒng)中數(shù)字處理技術(shù)的飛速發(fā)展,需要對雷達(dá)回波...
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