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三星BSPDN技術(shù)引領(lǐng)芯片創(chuàng)新:尺寸縮減17%,能效提升15%

CHANBAEK ? 來源:網(wǎng)絡(luò)整理 ? 作者:網(wǎng)絡(luò)整理 ? 2024-08-26 09:46 ? 次閱讀
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在近日舉行的西門子EDA論壇2024首爾站上,三星電子晶圓代工PDK開發(fā)團隊的高級副總裁Lee Sun-Jae向業(yè)界展示了其革命性的背面供電網(wǎng)絡(luò)(BSPDN)技術(shù)所帶來的顯著優(yōu)勢。據(jù)Lee介紹,BSPDN技術(shù)在2nm工藝節(jié)點上的SF2Z設(shè)計中展現(xiàn)出卓越性能,相較于傳統(tǒng)的正面供電網(wǎng)絡(luò)(FSPDN)方式,實現(xiàn)了前所未有的突破。

該技術(shù)通過優(yōu)化電路布局與供電機制,成功解決了長期困擾業(yè)界的電路壓降問題,不僅將芯片面積減少了約17%,還實現(xiàn)了能效約15%的顯著提升。更令人矚目的是,BSPDN技術(shù)還帶來了約8%的性能增強,為高性能芯片設(shè)計開辟了全新的可能性。

Lee Sun-Jae的分享無疑為半導體行業(yè)注入了一針強心劑,展示了三星電子在先進制程技術(shù)領(lǐng)域的深厚積累與創(chuàng)新能力。隨著BSPDN技術(shù)的逐步應(yīng)用與推廣,預(yù)計將為全球芯片設(shè)計領(lǐng)域帶來更加高效、緊湊的解決方案,推動電子產(chǎn)品向更小、更快、更節(jié)能的方向發(fā)展。

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