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基于FPGA的DDS信號源設(shè)計(jì)與實(shí)現(xiàn)
利用DDS和 FPGA 技術(shù)設(shè)計(jì)一種信號發(fā)生器.介紹了該信號發(fā)生器的工作原理、 設(shè)計(jì)思
路及實(shí)現(xiàn)方法.在 FPGA 器件上實(shí)現(xiàn)了基于 DDS技術(shù)的信號源 ,并可通過鍵盤控制其輸出波形的各種參數(shù) ,頻率可控范圍為 100 Hz～10 MHz ,頻率調(diào)節(jié)步進(jìn)為 100 Hz ,頻率轉(zhuǎn)換時(shí)間為 25ns.關(guān)鍵詞:信號源;現(xiàn)場可編程門陣列( FPGA) ;直接數(shù)字頻率合成(DDS)
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