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摘要：增強(qiáng)測試質(zhì)量和抑制測試代價是超深亞微米集成電路測試及可測性設(shè)計領(lǐng)域的兩個研究主題。本文介紹了一個基于Mentor公司可測性設(shè)計工具的面向多種故障模型的超深亞微米集成電路測試及可測性設(shè)計解決方案。該方案通過一個包含了Stuck-at故障測試、Delay故障測試和Delta-IDDQ測試在內(nèi)的測試集來提高超深亞微米集成電路的測試質(zhì)量，同時利用一種減少Stuck-at故障測試向量的策略來抑制測試代價的增長趨勢。論文還介紹了如何利用MentorGraghics公司的DFTAdvisor、FastScan、MBISTArchitect等可測性設(shè)計工具來完成一個0.18微米工藝微處理器設(shè)計中的實例。
關(guān)鍵詞：可測性設(shè)計；故障覆蓋率；自動測試生成；缺陷級別
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