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CPLD(Complex Programmable Logic Device)復(fù)雜可編程邏輯器件,是從PAL和GAL器件發(fā)展出來(lái)的器件,相對(duì)而言規(guī)模大,結(jié)構(gòu)復(fù)雜,屬于大規(guī)模集成電路范圍。是一種用戶根據(jù)各自需要而自行構(gòu)造邏輯功能的數(shù)字集成電路。其基本設(shè)計(jì)方法是借助集成開(kāi)發(fā)軟件平臺(tái),用原理圖、硬件描述語(yǔ)言等方法,生成相應(yīng)的目標(biāo)文件,通過(guò)下載電纜(“在系統(tǒng)”編程)將代碼傳送到目標(biāo)芯片中,實(shí)現(xiàn)設(shè)計(jì)的數(shù)字系統(tǒng)。
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摘要:針對(duì)嵌入式系統(tǒng)的精簡(jiǎn)特性,提出一種通過(guò)1個(gè)中斷源高效管理多個(gè)串行口的有效方法,不但節(jié)省系統(tǒng)資源,而且實(shí)現(xiàn)了多個(gè)串行口中斷的無(wú)漏檢測(cè)與服務(wù)。
2009-06-20 標(biāo)簽:CPLD 1.2k 0
用CPLD實(shí)現(xiàn)單片機(jī)讀寫(xiě)模塊
摘要:介紹實(shí)現(xiàn)單片機(jī)與Xilinx公司XC9500系列可編程邏輯器件的讀寫(xiě)邏輯功能模塊的接口設(shè)計(jì),以及Xilinx公司的XC9500系列可編程邏輯器件的...
2009-06-20 標(biāo)簽:CPLD 1.8k 0
非多路復(fù)用與多路復(fù)用總線轉(zhuǎn)換橋的設(shè)計(jì)與實(shí)現(xiàn)
摘要:提出了一種新穎的非多路復(fù)用總線與多路復(fù)用總線的轉(zhuǎn)換接口電路。以兩種總線的典型代表芯片TMS320F206與SJA1000為例,分
用CPLD實(shí)現(xiàn)DSP與PLX9054之間的連接
摘要: 介紹了利用CPLD實(shí)現(xiàn)DSP芯片TMS320C6711b和PCI橋芯片PLX9054之間高速數(shù)據(jù)傳輸?shù)南到y(tǒng)設(shè)計(jì)方法,并給出了相應(yīng)的系統(tǒng)設(shè)計(jì)原理圖...
2009-06-20 標(biāo)簽:CPLD 1.6k 0
MPC850中復(fù)位邏輯和CPM協(xié)議切換的CPLD實(shí)現(xiàn)
摘要: 介紹了用CPLD輔助設(shè)計(jì)在嵌入系統(tǒng)中進(jìn)行曲MPU復(fù)雜邏輯功能設(shè)計(jì)的總體方案,給出了通過(guò)對(duì)XC95144中復(fù)用控制寄存器進(jìn)行配置以實(shí)現(xiàn)MPU復(fù)位邏...
2009-06-20 標(biāo)簽:CPLD 1.2k 0
基于CPLD/FPGA的半整數(shù)分頻器的設(shè)計(jì)
摘要:簡(jiǎn)要介紹了CPLD/FPGA器件的特點(diǎn)和應(yīng)用范圍,并以分頻比為2.5的半整數(shù)分頻器的設(shè)計(jì)為例,介紹了在MAX+plus II開(kāi)發(fā)軟件下,利用VHD...
用VHDL語(yǔ)言在CPLD上實(shí)現(xiàn)串行通信
摘 要: 串行通信是實(shí)現(xiàn)遠(yuǎn)程測(cè)控的重要手段。采用VHDL語(yǔ)言在CPLD上實(shí)現(xiàn)了串行通信,完全可以脫離單片機(jī)使用。 關(guān)鍵詞:
2009-06-20 標(biāo)簽:CPLD 982 0
一、 配置方式 ALTERA CPLD器件的配置方式主要分為兩大類(lèi):主動(dòng)配置方式和被動(dòng)方式。主動(dòng)配置方式由CPLD器件引導(dǎo)配置操作過(guò)程,它控制著外...
低壓CPLD的混合電壓系統(tǒng)設(shè)計(jì)
摘要: 較詳細(xì)地闡述不同邏輯電平的接口原理。以低壓CPLD EPM7512A為例,給出在混合電壓系統(tǒng)中的具體設(shè)計(jì)方案。 關(guān)鍵詞: 低壓CPLD 邏輯電平
2009-06-20 標(biāo)簽:CPLD 1.2k 0
摘 要 :介紹ACEX 1K系列器件的配置方法,對(duì)幾種方法進(jìn)行了分析對(duì)比,并著重論述了應(yīng)用配置器件配置 ACEX 1K系列器件的優(yōu)點(diǎn)。 關(guān)鍵詞 :CPL
2009-06-20 標(biāo)簽:CPLD 808 0
Lattice CPLD器件的在系統(tǒng)動(dòng)態(tài)配置
以下是引用片段: 摘要: 介紹一種利用微控制器動(dòng)態(tài)配置CPLD器件的方法。將配置文件存放在存儲(chǔ)器中,配置文件中的控制代碼驅(qū)動(dòng)在微處理器中運(yùn)行的配置引擎;...
2009-06-20 標(biāo)簽:cpld 3.5k 0
討論如何使用CPLD實(shí)現(xiàn)單片機(jī)與曼徹斯特編解碼器的接口。設(shè)計(jì)時(shí)采用自頂向下的流程,具體電路可靈活地添加到各種曼徹斯特碼接口系統(tǒng)中。 關(guān)鍵詞 曼徹斯特...
基于CPLD技術(shù)的看門(mén)狗電路的設(shè)計(jì)
【摘 要】 介紹了一種基于CPLD器件設(shè)計(jì)看門(mén)狗電路的方法?! £P(guān)鍵詞:CPLD,看門(mén)狗,計(jì)數(shù)器 1 引 言 隨著現(xiàn)代電子技
2009-05-16 標(biāo)簽:CPLD 1k 0
用MAX+PLUSⅡ開(kāi)發(fā)Altera CPLD
【摘 要】 介紹利用MAX+PLUSⅡ軟件對(duì)Altera公司的CPLD進(jìn)行圖形設(shè)計(jì)、編譯以及在系統(tǒng)編程的基本方法和步驟。 &nbs...
2009-05-15 標(biāo)簽:CPLD 1.2k 0
VHDL語(yǔ)言在FPGA/CPLD開(kāi)發(fā)中的應(yīng)用?
【摘 要】 通過(guò)設(shè)計(jì)實(shí)例詳細(xì)介紹了用VHDL(VHSIC Hardware DescriptionLanguage)語(yǔ)言開(kāi)發(fā)FPGA/CPLD的方法,以...
2009-05-10 標(biāo)簽:CPLD 1.5k 0
利用CPLD實(shí)現(xiàn)多路數(shù)據(jù)采集
設(shè)計(jì)了以CPLD為核心處理芯片的多路數(shù)據(jù)采集系統(tǒng),整個(gè)數(shù)據(jù)采集系統(tǒng)可實(shí)現(xiàn)最大采集頻率為800kHz,通道數(shù)為48路的模擬信號(hào)的采集。系統(tǒng)中采用了TI公司...
2009-05-05 標(biāo)簽:CPLD 2.1k 0
介紹了基于CPLD的機(jī)載小型化控制與保護(hù)技術(shù),詳細(xì)敘述了控制與保護(hù)電路的組成與原理及其軟件設(shè)計(jì)。? 關(guān)鍵詞:CPLD...
2009-05-05 標(biāo)簽:CPLD 856 0
基于ARM和CPLD的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
數(shù)據(jù)采集系統(tǒng)是通過(guò)采樣電路將輸入的模擬信號(hào)轉(zhuǎn)換成離散信號(hào),并送入CPU、MCU或DSP進(jìn)行處理?,F(xiàn)在流行的基于PCI總線設(shè)計(jì)的采集卡是數(shù)據(jù)采集系統(tǒng)的主流...
2009-04-19 標(biāo)簽:CPLD 1.1k 0
什么是CPLD CPLD(Complex Programmable Logic Device)是Complex PLD的簡(jiǎn)稱(chēng),一種較PLD為復(fù)雜的邏輯...
2009-03-30 標(biāo)簽:CPLD 4.2k 0
采用圖像傳感器的CPLD視覺(jué)系統(tǒng)設(shè)計(jì)方法
采用圖像傳感器的CPLD視覺(jué)系統(tǒng)設(shè)計(jì)方法 搭建一種低成本的嵌入式視覺(jué)系統(tǒng),系統(tǒng)由CMOS圖像傳感器、CPLD、ARM7微處理器以及SRAM構(gòu)成。其中,...
2009-03-29 標(biāo)簽:CPLD 633 0
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