關(guān)鍵詞： MPEG-1 , 記錄 , 視頻 , 壓縮

引言

隨著計算機技術(shù)、多媒體和數(shù)據(jù)通信技術(shù)的迅速發(fā)展，數(shù)字視頻的應(yīng)用越來越廣，如視頻監(jiān)控、視頻會議和移動電視等。數(shù)字視頻數(shù)據(jù)量巨大，不利于傳輸和存儲，使其應(yīng)用受到很大限制。為解決視頻數(shù)據(jù)的存儲和傳輸問題，唯一的途徑就是對視頻數(shù)據(jù)進行壓縮。常見的視頻壓縮方法有MPEG系列和H.26x系列?？紤]到壓縮技術(shù)的成熟度、成本和主要用途，采用MPEG-1作為壓縮標準，設(shè)計出基于ARM處理器的嵌入式數(shù)字視頻記錄系統(tǒng)。該系統(tǒng)適用于視頻監(jiān)控、視頻會議等多種應(yīng)用場合，同時還可安裝在飛行器上，用于實時記錄飛行器的飛行及訓(xùn)練過程中的各種信息。  

目前，市場上有大量的基于PCI總線的MPEG-1視頻壓縮卡和PC機構(gòu)架的網(wǎng)絡(luò)視頻服務(wù)器。與之相比，我們設(shè)計的視頻記錄系統(tǒng)具有成本低、體積小和功耗低等優(yōu)勢。

1 系統(tǒng)工作原理  

視頻壓縮記錄系統(tǒng)的設(shè)計著眼于控制器的嵌入化和整體的便攜性。本系統(tǒng)主要由3部分組成，即壓縮部分、控制部分和存儲部分。視頻記錄系統(tǒng)的結(jié)構(gòu)組成如圖1所示。其中壓縮部分由MPEG1音視頻壓縮電路組成，主要功能是實現(xiàn)對輸入的音視頻信號解 碼、數(shù)字化和壓縮編碼，產(chǎn)生MPEG1程序流和傳輸流；控制部分由ARM最小系統(tǒng)組成，用于實現(xiàn)對整個系統(tǒng)的控制、數(shù)據(jù)流管理和IDE接口控制；存儲部分由大容量硬盤或CF存儲卡組成，實現(xiàn)對壓縮數(shù)據(jù)的實時長時間記錄。

系統(tǒng)啟動時，ARM處理器對整個壓縮系統(tǒng)進行初始化，首先通過HOST接口對SZ1510內(nèi)部寄存器進行配置，并使用SZ1510的串行接口模擬I2C總線對視頻解碼器SAA7113H進行初始化。當設(shè)置好MPEG-1的壓縮格式及數(shù)據(jù)速率后，系統(tǒng)開始正常工作，音視頻信號經(jīng)AK4550音頻處理芯片和SAA7113視頻處理芯片進行A/D轉(zhuǎn)換，輸出8位的PCM格式數(shù)字音頻信號和4∶2∶0的YCbCr數(shù)字視頻信號，傳入SZ1510音視頻壓縮采集芯片進行處理，將數(shù)字音視頻數(shù)據(jù)轉(zhuǎn)化為符合MPEG-1格式的混合影視文件，最后MPEG1數(shù)據(jù)流在ARM處理器的控制下通過IDE接口寫入硬盤或CF卡。在工作時，ARM還將不斷監(jiān)視相關(guān)信號，并在圖像中加入相應(yīng)的標志，直到接收到關(guān)機信號，系統(tǒng)自動結(jié)束壓縮工作。

2 硬件電路設(shè)計  

由于MPEG-1壓縮算法需要很大的運算量，用軟件實時完成比較困難，所以在本系統(tǒng)中主要依靠專用芯片實現(xiàn)對視頻信號的高效壓縮。目前，常用的MPEG-1壓縮芯片有VW2010、W99200F、WIS 7007SB等。本設(shè)計采用的是Zapex公司的SZ1510 MPEG-1 A/V編碼芯片，自身完成音視頻的同步編碼，16位HOST接口易于與多種微處理器連接。另外，該芯片還可以直接控制視頻解碼芯片SAA7113H、音頻解碼芯片AK4550VT和SDRAM（KM416S1020CT-G10）。CPU采用Philips公司的ARM7TDMIS內(nèi)核微控制器LPC2214，通過其I/O端口控制IDE接口硬盤或CF卡的數(shù)據(jù)讀取和存儲。

                                       圖1 數(shù)字視頻記錄系統(tǒng)結(jié)構(gòu)框圖  

2.1 MPEG-1壓縮電路設(shè)計  

SZ1510是一個 MPEG-1和運動JPEG圖像編碼器。其內(nèi)置的視頻壓縮核經(jīng)過優(yōu)化，適合高效、實時的MPEG1數(shù)字圖像壓縮，具有功能多、功耗低、溫度范圍寬等特點；同時整合了TI公司的TMS320C54X高性能DSP內(nèi)核，可依據(jù)MPEG-1標準對音視頻同步編碼。

（1） 時鐘同步電路設(shè)置  

SZ1510是一個復(fù)雜的視頻壓縮小系統(tǒng)，要完成音視頻的同步，MPEG-1視頻的壓縮以及系統(tǒng)內(nèi)部數(shù)據(jù)流的復(fù)合、調(diào)度；時鐘關(guān)系較為復(fù)雜，是系統(tǒng)設(shè)計的一個難點。時鐘配置可分為主時鐘、音視頻時鐘、視頻壓縮核時鐘、DSP核時鐘以及擴展的I2S接口時鐘幾部分。其功能和關(guān)系為：

◆ 主時鐘。SZ1510的主時鐘為穩(wěn)定的27 MHz(CLK)。該時鐘在芯片內(nèi)部被PLL1倍頻為81 MHz，驅(qū)動SZ1510的視頻壓縮核及SDRAM。PLL2連到DSP內(nèi)核，通過軟件配置使其工作在94.5 MHz，用于音頻壓縮和系統(tǒng)數(shù)據(jù)流復(fù)合。

◆ 音視頻時鐘。視頻時鐘來自視頻解碼器，典型值為27 MHz。音頻時鐘由視頻時鐘分頻產(chǎn)生。

◆ I2S接口時鐘。本系統(tǒng)中在音視頻同步設(shè)計中使用I2S接口的從模式，由SZ1510產(chǎn)生串行時鐘和幀同步信號。

（2） 主機（HOST）端口設(shè)置  

SZ1510作為從設(shè)備，受主機控制，其HOST接口是SZ1510的控制和數(shù)據(jù)交換接口。SZ1510可以選擇復(fù)用或不復(fù)用的Intel和Motorola總線類型；不復(fù)用總線，又可以分為8位和16位。具體的主機端口由HCONFIG[1∶0]引腳和SysConfig寄存器配置。在本系統(tǒng)設(shè)計中，通過跳線把HCONFIG0拉低，HCONFIG1拉高，使其工作在Intel 8051類型的非復(fù)用的16位數(shù)據(jù)總線模式下。  

2.2 LPC2214微處理器電路設(shè)計  

LPC2214是一款基于32位ARM7TDMI-S，支持實時仿真和跟蹤的CPU；帶有16 KB片內(nèi)SRAM、256 KB嵌入的高速Flash存儲器、128位寬度的存儲器接口和獨特的加速結(jié)構(gòu)，使32位代碼能夠在最大時鐘速率60 MHz下運行。芯片內(nèi)部集成了多種串行接口。LPC2214與SZ1510的接口和控制關(guān)系如圖2所示。在設(shè)計中，需要注意的是保持SZ1510讀寫時序與內(nèi)部時鐘的同步。通過CS3選通SZ1510實現(xiàn)控制字和數(shù)據(jù)的交換。