Cadence 數(shù)字、定制/模擬設(shè)計流程通過認證，Design IP 現(xiàn)已支持 Intel 16 FinFET 制程
內(nèi)容提要 ● ?Cadence 流程已通過認證，可立即投入生產(chǎn)，該工藝下 Design IP 產(chǎn)品現(xiàn)....
Virtuoso Studio 大神集結(jié)！尋找對平臺了如指掌的你（第三期）
關(guān)于 Virtuoso Studio? 人們對智能化極致的需求讓芯片設(shè)計面臨著巨大壓力，一方面是復(fù)雜....
Cadence 推出經(jīng)過認證的創(chuàng)新背面實現(xiàn)流程，以支持 Samsung Foundry SF2 技術(shù)
內(nèi)容提要 ●? 完整的背面布線解決方案，助力面向移動、汽車、人工智能和超大規(guī)模應(yīng)用的下一代高性能芯片....
Cadence 擴大了與 Samsung Foundry 的合作，依托 Integrity 3D-IC平臺提供獨具優(yōu)勢的參考流程
?? 雙方利用 Cadence 的 Integrity 3D-IC 平臺，優(yōu)化多晶粒規(guī)劃和實現(xiàn)，該平....
Cadence數(shù)字和定制/模擬流程通過Samsung Foundry的SF2、SF3工藝技術(shù)認證
內(nèi)容提要 ● Cadence 和 Samsung 的合作，使客戶能夠利用兩個公司最新的技術(shù)，進行手機....
Cadence 數(shù)字和定制/模擬設(shè)計流程獲得 Samsung Foundry SF2 和 SF3 工藝技術(shù)認證
內(nèi)容提要 ● Cadence 和 Samsung 的合作，使客戶能夠利用兩個公司最新的技術(shù)，進行手機....
Cadence Virtuoso Studio流程獲得Samsung Foundry認證，支持先進工藝技術(shù)的模擬IP自動遷移
內(nèi)容提要 1 輕松實現(xiàn)節(jié)點到節(jié)點的設(shè)計和 layout 遷移 2 將定制/模擬設(shè)計遷移速度提升 2 ....
Cadence基于AI的Cadence Virtuoso Studio設(shè)計工具獲得認證
●?Samsung Foundry 有眾多 PDK 系列，可搭配 Virtuoso Studio 用....
更快，更強，更智能：Cadence 新型電源網(wǎng)絡(luò)設(shè)計方法介紹
本文作者： DSG Product Engineering Group 劉杰 我們知道，一塊芯片的性....
Cadence 于 2023 PCI-SIG 開發(fā)者大會期間展示 PCIe7.0-Ready IP
本文翻譯轉(zhuǎn)載于：Cadence blog 作者：Arif Khan PCIe 7.0 規(guī)范起草階段持....
【西安線下】就在明天！PCB,封裝設(shè)計及系統(tǒng)SI/PI/Thermal仿真專場—2023 Cadence中國技術(shù)巡回研討會
電子設(shè)計自動化領(lǐng)域領(lǐng)先的供應(yīng)商?Cadence，誠邀您參加“ 2023 Cadence 中國技術(shù)巡回....
直播就在明天！Cadence Fidelity 葉輪機械設(shè)計與優(yōu)化系列專題——第二期：基于混合網(wǎng)格的渦輪增壓器 CFD 仿真
旋轉(zhuǎn)機械的 CFD 模擬需要設(shè)置旋轉(zhuǎn)和靜止兩個計算域。構(gòu)建旋轉(zhuǎn)區(qū)域和靜止區(qū)域的網(wǎng)格并建立兩個區(qū)域的數(shù)....
DB GlobalChip有效運用Cadence的Spectre FX和AMS Designer，將IP驗證速度加快2倍
Cadence Spectre 技術(shù)助力 DB GlobalChip 加速模擬和混合信號 IP 開發(fā)....
【西安線下】火熱報名中！PCB,封裝設(shè)計及系統(tǒng)SI/PI/Thermal仿真專場—2023 Cadence中國技術(shù)巡回研討會
電子設(shè)計自動化領(lǐng)域領(lǐng)先的供應(yīng)商?Cadence，誠邀您參加“ 2023 Cadence 中國技術(shù)巡回....
【上海線下】就在明天！PCB,封裝設(shè)計及系統(tǒng)SI/PI/Thermal仿真專場—2023 Cadence中國技術(shù)巡回研討會
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Cadence 與 Samsung Foundry 達成多年期協(xié)議以擴展其設(shè)計 IP 產(chǎn)品組合
高級存儲器接口 IP 解決方案擴展到 SF3 并支持具有豐富接口協(xié)議的完整 SF5A 設(shè)計 IP 組....
【深圳線下】就在明天！PCB,封裝設(shè)計及系統(tǒng)SI/PI/Thermal仿真專場—2023 Cadence中國技術(shù)巡回研討會
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快來測測你對 Virtuoso Studio 了解多少？（第二期）
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【北京線下】就在明天！PCB,封裝設(shè)計及系統(tǒng)SI/PI/Thermal仿真專場—2023 Cadence中國技術(shù)巡回研討會
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【北京線下】就在明天！HPC 芯片全流程驗證解決方案專場研討會 — 北京站
電子設(shè)計自動化領(lǐng)域領(lǐng)先的供應(yīng)商 Cadence，誠邀您參加 “2023 CadenceCONNECT....
Virtuoso Studio引領(lǐng)模擬設(shè)計變革
吞吐量的上漲可能來源于仿真任務(wù)的執(zhí)行，即成百上千個任務(wù)的累加。通過 Virtuoso ADE 產(chǎn)品套....
Cadence 詮釋渦輪機械應(yīng)用先進CFD 技術(shù)
本屆大會有超過 600 位杰出行業(yè)代表齊聚上海，與來自全球優(yōu)秀的航空和燃氣渦輪領(lǐng)域的從業(yè)者匯聚一堂，....
EDA 如何助力大芯片產(chǎn)業(yè)成功破局
在金融服務(wù)、智能制造、醫(yī)療保健以及媒體娛樂等行業(yè)的推動下，全球數(shù)據(jù)呈現(xiàn)爆發(fā)態(tài)勢。根據(jù) IDC Glo....
什么是網(wǎng)格劃分或網(wǎng)格生成？
龐雜的幾何文件、復(fù)雜的幾何結(jié)構(gòu)，使得 CFD 仿真在網(wǎng)格制作上極其耗時。如何解放工程師的雙手， 把更....
Cadence發(fā)布面向TSMC 3nm工藝的112G-ELR SerDes IP展示
3nm 時代來臨了！Cadence 在 2023 年 TSMC 北美技術(shù)研討會期間發(fā)布了面向臺積電 ....
工商網(wǎng)監(jiān)