閑話Zynq UltraScale+ MPSoC（連載2）

作者：Hello，Panda
Zynq UltraScale+ MPSoC架構
Xilinx新一代Zynq針對控制、圖像和網(wǎng)絡應用推出了差異化的產(chǎn)品系，這在Xilinx早期的宣傳和現(xiàn)在已經(jīng)發(fā)布的文檔里已經(jīng)說得很清楚了。她的產(chǎn)品系如圖2所示。

圖2 產(chǎn)品表
從圖2看到，這個系列的Zynq算是8核（或9核）異構產(chǎn)品：四核的ARM-CortexA53 CPU、雙核的Cortex-R5 RPU、Mali-400 GPU（一個Geometry核，兩個像素核）、PL邏輯以及視頻編解碼器Codec核。
在表2中，ZU2E、ZU3E為針對控制類應用，邏輯和Block RAM資源較少，沒有Video Codec和高速收發(fā)器。ZU4E、ZU2E和ZU7E針對視頻類應用，有內(nèi)部的UltraRAM資源、Video Codec和GTH高速收發(fā)器。其他型號針對網(wǎng)絡應用，除了Video Code沒有外，其它高大上的東西都有，比如更高速的收發(fā)器GTY，還有150G Interlaken和100G Ethernet MAC/PCS/RS-FEC等。
熊貓君是做圖像的，下面的描述都是針對圖像版的Zynq UltraScale+而言的。
因為PS部分的資源是固定的，大家都一樣，在后面一起說就行。PL部分因為有這三個東西，將使設計如虎添翼：
a)大量的Block RAM和Ultra RAM資源，小20Mb的內(nèi)部RAM資源，對分塊處理圖像，那應該會帶來不少的便捷；
b)Video Code：這個東西是集成在PL側(cè)的硬核，有了它，圖像壓縮和解壓縮都不用愁了；
c)GTH：PL端集成的GTH收發(fā)器，對SDI、DP等圖像接口接入那是十分的方便，當然也可以做PCIe咯。
不多說了，熊貓君從Xilinx官方文檔UG1085上截一個圖來表示這個高大上通用SoC的系統(tǒng)級架構，也就是下面的圖3啦。

閑話Zynq UltraScale+ MPSoC（連載2）

圖3 Zynq UltraScale+ MPSoC系統(tǒng)架構圖
當初剛看到這個架構的時候，可高興壞熊貓寶寶了，一連吃了好幾框竹筍才勉強壓了驚。冷靜之余，還讓熊貓君慢慢道來。
什么16nm級工藝的先進性啊什么什么各種先進技術的應用之類的咱不聊，那是Xilinx的事兒，咱就重點閑掰扯一下這貨怎么用。目前熊貓君打算就以下幾個方面入手：
（1）關于硬件設計的：
a) 電源系統(tǒng)和上電時序；
b) 啟動加載；
c) IO資源；
d) 系統(tǒng)整體性能匯總（根據(jù)Xilinx提供的官方資料整理）。
（2）內(nèi)部互聯(lián)結構
可不要小看了這一部分，這是SoC的核心內(nèi)容，所以單獨拿出來。
（3）關于軟件設計的
好吧，熊貓君也沒有拿到試用版的開發(fā)套件，只能根據(jù)自己的認識+官方文檔聊聊了。

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